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Internet Message Format  |  1996-08-05  |  5.4 KB

  1. Path: beavis.kronos.com!usenet
  2. From: porter_woodward@internet.kronos.com (Porter Woodward)
  3. Newsgroups: comp.sys.amiga.programmer
  4. Subject: Re: AB3D II beats Quake....
  5. Date: 1 Apr 1996 12:44:20 GMT
  6. Organization: Software Quality Assurance
  7. Distribution: world
  8. Message-ID: <4joj34$5d2@beavis.kronos.com>
  9. References: <john.hendrikx.4ph5@grafix.xs4all.nl>
  10. NNTP-Posting-Host: 158.228.60.147
  11. Mime-Version: 1.0
  12. Content-Type: Text/Plain; charset=US-ASCII
  13. X-Newsreader: WinVN 0.99.7
  14.  
  15. In article <john.hendrikx.4ph5@grafix.xs4all.nl>, john.hendrikx@grafix.xs4all.nl says...
  16. >
  17. >In a message of 28 Mar 96 Stephan Schaem wrote to All:
  18. >
  19. >Sure, but I bet it costs Intel more than 10 times as much money to get the P6
  20. >to perform as well as the PPC604.  Just think of what the PPC604 could have
  21. >been with 10 times as large a budget.  Also I think integrating a huge cache on
  22. >the chip had a LOT more to do with the current performance of the P6 (and of
  23. >course the usual overinflated Intel specmarks).
  24. >
  25.     It made a huge difference!  In a register poor environment like a x86
  26. chip - you have to have a large on chip cache to make up for the deficiencies
  27. of the slow operation of memory fetches!  This in turn can push the price of a
  28. chip up - In fact, to achieve "decent" preformance, P5s need L2 cache - and,
  29. believe me that ain't exactly cheap.
  30.  
  31. > >> Again, I don't agree. The problem is not the size of the opcode, but the
  32. > >> time needed to execute it. Allowing 1 byte opcode means you won't be able
  33. > >> to do pipelining and predecoding of the instructions flow. I don't think
  34. > >> any chip firm today would go that way, ie using 1 byte opcode.
  35. >
  36. > SS>  Its hard to say what would be the best instruction size/format...
  37. >
  38. >Maybe, but I think there are definitely very good reasons not to use 16 bit or
  39. >8 bit instructions sizes anymore.
  40.  
  41.     That's the truth.  Why limit ourselves to itsy bitsy instruction sizes
  42. anymore.  Although there are a finite number of instructions that are feasible,
  43. it would be useful to have a 64bit instruction size so that later expansion of the
  44. instruction set wouldn't tromp all over the existing instructions.
  45.  
  46. >
  47. > >> >Intel is not dumb, they said 3 years ago what I understood nowadays.
  48. > >> >Time for other people to understand it as well. >
  49. > >> Intel is producing mass CPU, not clever CPU. I'm much more interested in
  50. > >> work and advices from HP, MIPS, ...
  51. >
  52. > SS> Intel also design advance risc that even SGI used for high end
  53. > SS> geometry engine. HP also use intel risc in mass quatity. Intel
  54. > SS> is not stupid and has ALOT of resource to take crap design like
  55. > SS> the x86 and turn it around to be a performer.
  56. >
  57. >Performer?  Why not divide the 'performance' by the price-tag and compare it
  58. >with other chips.
  59. >
  60.     Intel is plenty clever.  Although I wouldn't rate the x86 design as
  61. an "elegant" one, it is effective.  And that is what matters.  Additionally,
  62. couple that with the fact that most professional business software runs on
  63. an OS that pretty much only runs on Intel processors...  And there is very
  64. little for them to worry about.
  65.  
  66.     A PPC604 with native software, etc. Is quite impressive in terms
  67. of speed - Easily as fast as a Pentium, and with hand tuned code, much
  68. faster.  There are just some things that are possible with RISC that are
  69. much harder to do in CISC.  And forget that crap about a 620 being slow.
  70. You are talking Sparc/MIPS performance.
  71.  
  72. > >> One of the big problem with the x86, is the poor number of register and
  73. > >> the way they have to be used. Really, having 32 or 64 regs (PPC) greatly
  74. > >> helps speeding up execution (as an  ASM supporter, I think you will agree
  75. > >> on the importance of the number of registers).
  76. >
  77. >C compilers like lots of registers as well, especially if they are general
  78. >purpose registers.  It not only makes good compilers easier to write (there are
  79. >a lot less rules to be taken into account), it probably also makes for faster
  80. >compile times (less special cases to check and optimize).
  81. >
  82.     It's only recently that compilers have started taking major
  83. advantage of register rich environments.  That is one of the major
  84. reasons that RISC was unable to prove it's superiority over CISC years
  85. ago.  We're talking early 80s here.  C was just coming into 'Vogue', and
  86. compiler technology wasn't in any way shape or form as advanced as
  87. it is now.
  88.  
  89.     Now, compilers can in-line function calls, unroll loops, etc.  A number
  90. of the tricks that we do with hand tuned code are still beyond them, but
  91. the things that they can do are the tasks we would find quite tedious.
  92. -- 
  93. ****************************************************************
  94.              (Oh, so that's what's on the other side!)          
  95.             o   "Sometimes truth IS stranger than fiction."     
  96.            o  I can be reached at:                              
  97.           o   porter_woodward@internet.kronos.com -daytime      
  98.        \|/    OR     woodward@acad.wit.edu        -nights       
  99.        @ @    OR   http://www.kronos.com/~porter/ -always       
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  102.    |+------------------------------------+ | @ |   |  OUTSIDE  |
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  105. @  |+------------------------------------+ |   |  o|   | TO|   |
  106.    |   |   |   |   |   |   |   |   |   |   |*  |   | Micro$oft |
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